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Verilog设计：KR-FEC /FEC (2112,2080) 编解码实现

FPGA开发

IEEE Std 802.3-2022 KR-FEC原理

本文参考 IEEE Std 802.3-2022 Clause 74 章节。

阅读笔记 IEEE Std 802.3-2022

IEEE Std 802.3-2022 PCS 64b/66b原理

10GBASE-R中的PCS层 IEEE Std 802.3-2022 在 49章，介绍了10GBASE-R的PCS（Physical Coding Sublayer，物理编码子层）64b/66b原理。下面这几个 10G 以太网物理层变种均使用该同步头： 10GBASE-SR（多模光纤，短距离）

阅读笔记 IEEE Std 802.3-2022

Verilog设计：简易的PCS模块66b同步设计

本文基于IEEE Std 802.3-2022 PCS 章节，介绍几种66b同步方法，处理位宽包括64bit数据到32bit数据，并给出一些优化方案。整个简化流程可以表示为： 64bit输入数据->增加同步头->转换成64bit位宽数据-----> PMA tx ----->PMA rx ----

FPGA开发

Verilog设计：分优先级的CPU访问接口协议设计

问题背景：模块A内部有一块RAM作为内部状态信息缓存，这个信息一方面需要被内部逻辑进行读写，一方面又需要被外部CPU总线读写，此时已经在模块A中分了时隙用于同时处理两个接口访问。现在模块B也需要对模块A中的RAM进行访问，并且优先级比CPU总线要高，因为外部CPU访问没那么紧急，都是可以挂起等待的。

FPGA开发

IEEE Standard for Ethernet 2022（802.3 以太网协议）

一个开放协议下载搞这么麻烦，神经。IEEE Standard for Ethernet-2022.pdf

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IEEE Standard for Ethernet 2022（802.3 以太网协议）

紫光Logos 系列 FPGA 专用 RAM 模块(DRM) 用户指南

本系列文章为平时对FPGA手册的学习总结，希望能帮助大家理解手册，学会IP的使用。手册为网络收集，下载链接：Logos 系列 FPGA 专用 RAM 模块(DRM) 用户指南。对于这个文档有任何疑问，可以在评论下留言，基本上我已经翻烂了，也不知道该讲些什么。

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UG902_安路科技PH1A系列FPGA ERAM用户手册

本系列文章为平时对FPGA手册的学习总结，希望能帮助大家理解手册，学会IP的使用。手册为网络收集，下载链接：UG902_安路科技PH1A系列FPGA ERAM用户手册。写在前面：不吐不快，安路的这份手册是我见过最烂的器件手册，难想象这是经过评审的正式文档，到处都是信号/参数说明缺失，图/表对应不上

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UG909_安路科技PH1A系列FPGA+SERDES用户手册

本系列文章为平时对FPGA手册的学习总结，希望能帮助大家理解手册，学会IP的使用。手册为网络收集，下载链接：UG909_安路科技PH1A系列FPGA+SERDES用户手册。

FPGA开发 Serdes 资源分享阅读笔记

Serdes 学习笔记，CDR时钟恢复（其一，基本 CDR原理和结构）

本系列文章为《High Speed Serdes Devices and Applications》的学习总结，素材主要取自教材，并附带一些自己的思考。原书下载链接：High Speed Serdes Devices and Applications.pdf. 时钟恢复（Clock Data Rec

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